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Dual-Phase, Quick-PWM Controller
for IMVP6+ CPU Core Power Supplies
Slow C4 Deeper Sleep Exit: When exiting deeper sleep
(DPRSLPVR high, DPRSTP pulled high) while the output
voltage is regulating to the deeper sleep voltage, the
MAX17410 remains in 1-phase skip mode and ramps
the output voltage to the LFM DAC code provided by
ACTIVE VID
the processor at 1/4 the slew rate set by R TIME . The
controller blanks PWRGD, PHASEGD, and CLKEN
(forced high impedance) until 20μs after the transition is
completed. See Figure 6.
SLOW
SLEW RATE
CPU CORE VOLTAGE
VID (D0–D6)
DPRSLPVR
INTERNAL
TARGET
ACTUAL V OUT
DEEPER SLEEP VID
SLOW
LFM VID
LFM VID
DPRSLP VID
SLEW RATE
DPRSTP
PSI
DO NOT CARE (DPRSLPVR DOMINATES STATE)
INTERNAL
PWM CONTROL
DH1
DH2
1-PHASE SKIP (DH1 ACTIVE, DH2 = DL2 = FORCED LOW)
NO PULSES: V OUT > V TARGET
1-PHASE FORCED PWM
PWRGD
CLKEN
PHASEGD
OVP
BLANK HIGH-Z
BLANK LOW
SET TO 1.75V MIN
t BLANK
20 μ s TYP
BLANK HIGH THRESHOLD ONLY
BLANK HIGH THRESHOLD ONLY
BLANK HIGH-Z (1-PHASE OPERATION)
BLANK HIGH-Z
BLANK LOW
TRACKS INTERNAL TARGET
t BLANK
20 μ s TYP
Figure 6. Slow C4 Transition
______________________________________________________________________________________
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